Модели встроенного ремонта логических блоков

Abstract

RU: Предложены модели комбинационных схем, ориентированные на решение практических задач встроенного восстановления работоспособности компонентов логических устройств. Логическая схема дополняется операционным и управляющим автоматами моделирования цифровых устройств, что увеличивает время обработки и аппаратные затраты для создания оболочки адресуемых элементов. Структуры также можно использовать для аппаратного моделирования функциональностей цифровых проектов на основе использования PLD, что дает возможность существенно повысить быстродействие верификации программных моделей. Предложенное решение задачи встроенного ремонта логических элементов комбинационных схем дает возможность комплексно решать проблему автономного восстановления работоспособности цифровых систем на кристаллах за счет временной и аппаратной избыточности проекта [1–23]. UK: Запропоновано моделі комбінаційних схем, орієнтовані на розв’язання практичних задач убудованого відновлення працездатності компонентів логічних пристроїв. Логічна схема доповнюється операційним і керуючим автоматами моделювання цифрових пристроїв, що збільшує час обробки та апаратні витрати для створення оболонки елементів, що адресуються. Структури також можна використовувати для апаратного моделювання функціональностей цифрових проектів на основі використання PLD, що дає можливість суттєво підвищити швидкодію верифікації програмних моделей. Запропоноване рішення задачі вбудованого ремонту логічних елементів комбінаційних схем дає можливість комплексно вирішувати проблему автономного відновлення працездатності цифрових систем на кристалах за рахунок часової та апаратної надлишковості проекту. EN: The goal of this article is to improve the quality and reliability of digital systems-on-chips by creating an infrastructure for embedded testing, diagnosis, optimization and repairing through the use of hardware redundancy and reduce the speed of functional operations. The models of combinational circuits, focused on solving real-world problems of embedded repairing components of the logic devices, are proposed. The logical scheme is improved by using operational and control automaton for modeling digital devices, and focused on solving practical problems of embedded repairing logic components by increasing the processing time and additional hardware costs to create wrapper of addressable elements. The proposed structures can also be used for hardware modeling functionalities of digital projects through the use of PLD, which allows significantly improving the performance of software model verification. The proposed solution of embedded repair of gates for combinational circuits makes it possible to comprehensively solve the problem of autonomous repair of digital system-on-chip through the use of time and hardware design redundancy.